TSMCが2026年4月22日、米国カリフォルニア州サンタクララで開催した「2026 North America Technology Symposium」において、最先端プロセス技術 A13を初公開した。
A13は2025年に発表された A14ノードの直接微細化版で、A14比で6%の面積削減を実現し、設計ルールは A14と完全な後方互換性を持つ。量産開始は A14の1年後となる2029年を予定する。同シンポジウムでは A12、N2U、14レチクルサイズ CoWoS、A14-to-A14 SoIC、TSMC-COUPE、N2A、N16HVなども発表された。会長兼CEOは C.C.ウェイ博士。テーマは「Expanding AI with Leadership Silicon」。TSMCは2025年に305種類のプロセス技術で534社向けに12,682製品を製造した。
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TSMC Debuts A13 Technology at 2026 North America Technology Symposium
【編集部解説】
今回の発表で最も注目すべきは、A13が単独の新技術というより、TSMCが「ノード戦略の二極化」を初めて明確に公言した点にあります。同社は今後、スマートフォンやクライアント機器向けには毎年新ノードを投入し、AI・HPC（ハイパフォーマンスコンピューティング）データセンター向けには2年ごとに大規模アーキテクチャ刷新を行う方針を打ち出しました。A13と N2Uは前者（毎年系）、A12と A16は後者（2年系）に位置付けられています。AI需要の桁違いな伸びに対応する設計判断と読み解けます。
A13の「6%の面積削減」という数字は一見地味に映るかもしれません。しかしこの「ダイレクトシュリンク（光学的縮小）」という手法には、深い意味があります。A14の設計資産（IP）をほぼそのまま流用しつつ、トランジスタ密度を上げられるため、顧客は再設計コストをほとんど負担せずに性能改善を享受できます。Apple、NVIDIA、AMDなどの大口顧客にとって、これは設計サイクルの加速と投資効率の最大化を意味する、極めて実利的な選択肢となります。
技術ロードマップ全体で、もう一つ重要なのが「High-NA EUV装置を2029年まで使わない」という宣言です。1台あたり約3億8000万ドル（約570億円）とも報じられる ASML製の最新リソグラフィ装置を、TSMCは敢えて見送ります。これは Intelが14Aで High-NA EUV採用を前面に押し出している戦略と真っ向から対照的です。背景には、既存のロー NA EUV装置でマルチパターニングを駆使すれば1.3nm級まで微細化できるという、TSMC研究開発陣の自信があります。技術的合理性とコスト管理を両立させる、極めて TSMCらしい判断と言えるでしょう。
パッケージング技術では、CoWoS（Chip on Wafer on Substrate）の14レチクルサイズ化が大きな意味を持ちます。1つのパッケージに約10個の大型コンピュートダイと20個の HBMスタックを統合できる規模で、現行の5.5レチクルから2.5倍以上の拡張です。AIアクセラレーターは「もう1チップでは足りない」段階に入っており、複数のダイを高速接続して1つの巨大プロセッサとして振る舞わせる時代が、本格的に到来します。「ムーアの法則は終わった」という言説に対し、TSMCは「微細化の限界をパッケージングで突破する」という明確な答えを示しているのです。
シリコンフォトニクス分野での COUPE（Compact Universal Photonic Engine）の2026年量産開始も画期的な動きです。電気信号を光信号に変換する光エンジンをパッケージ内部に直接統合することで、データセンター内のラック間通信における電力効率を2倍、レイテンシを10分の1に改善できるとされます。NVIDIAも自社の Quantum-Xや Spectrum-X光スイッチで TSMC-COUPE技術を採用しており、AIデータセンターの電力消費問題を解決する切り札として、業界全体が注目しています。
車載・ロボティクス分野での N2A発表は、フィジカル AI時代の到来を象徴しています。注目すべきは、TSMCがプレスリリースの中で、ヒューマノイドロボットなどのフィジカル AIアプリケーションが、ADASや自動運転と同水準の品質・信頼性要件を求めるようになっていると明言した点です。Teslaの Optimusや Figure AI、1X Technologiesといった企業が開発を進めるヒューマノイドロボットが、車載チップと同水準の安全性・信頼性を要求する新たな半導体市場として浮上しつつあります。同社はこれまでアナログ的な印象が強かった車載半導体市場を、最先端ロジックの主戦場へと引き上げようとしています。
一方で潜在的なリスクも見逃せません。CoWoSの容量逼迫はまだ続くと NVIDIAや TSMC自身が認めており、AIチップ供給のボトルネックが当面解消されない見通しです。また、Intelが14Aで Backside Power Delivery（裏面電源供給）を先行実装することで、HPC領域での技術的優位性を一部失う可能性もあります。A16の量産時期も「2026年に準備完了、2027年から本格立ち上げ」とされています。
地政学的な観点では、台湾一極集中という構造リスクが依然として残ります。米国アリゾナ州への 1650億ドル投資（2025年3月時点）、日本・熊本での JASM工場稼働、ドイツ・ドレスデンでの建設計画など分散は進んでいますが、最先端ノードの量産は依然として台湾本土が中心です。米中対立の長期化、中東情勢の不安定化など、地政学的なドミノが TSMCの生産計画に与える影響は今後も注視が必要となります。
日本の読者にとって特に意味深いのは、Rapidusとの対比です。Rapidusは2027年後半の2nm量産開始を目指していますが、TSMCはすでに N2を 2025年Q4から量産入りさせ、2029年には1.3nm級の A13まで見据えています。世代差は厳然として存在しますが、Rapidusの「2nm世代で参入」という選択は、TSMCの2年サイクル戦略の隙間を突く合理的な戦略とも読めます。日本の半導体復活戦略が現実的な軌道に乗るかどうか、今回の TSMCロードマップは重要な比較軸を提供してくれます。
長期的な視座で見ると、TSMCの今回の発表は「半導体産業が1兆5000億ドル市場（2030年予測）へ向かう途上で、AIが全体の55%超を占めるようになる」という同社自身の予測と整合しています。スマートフォンが牽引した過去20年から、AI・HPCが牽引する次の20年へ──。その移行期の中心に立つファウンドリが、自らの設計思想を再定義した発表と捉えるべきでしょう。私たちが日々使うスマートグラスから、データセンターで動く生成 AI、自動運転車、ヒューマノイドロボットまで、すべての「未来の体験」が、このロードマップの上に築かれていきます。
【参考情報】
ナノシートトランジスタ（Gate-All-Around / GAA）
従来の FinFET（フィンフェット）に代わる次世代トランジスタ構造である。電流の通り道（チャネル）の四方をゲートが完全に取り囲むことで、リーク電流を抑え、性能と電力効率を大幅に改善する。TSMCの2nm（N2）以降のノードで採用されている。
ダイレクトシュリンク（光学的縮小）
既存のプロセス技術の設計ルールをほぼ維持したまま、リソグラフィの倍率調整などにより回路を物理的に縮小する手法である。新規設計コストを抑えつつトランジスタ密度を高められるため、顧客の IP流用が容易になる。
デザイン・テクノロジー協調最適化（DTCO）
プロセス技術と回路設計を一体的に最適化する設計手法である。トランジスタやセル構造の改良だけでなく、設計側の工夫も組み合わせて、性能・電力・面積（PPA）を引き出す。
Super Power Rail（SPR）/ 裏面電源供給（BSPDN）
従来チップの表面側に配置していた電源供給ラインを、ウェハの裏面に移動させる技術である。信号配線と電源配線を分離することで、電圧降下（IRドロップ）を抑え、配線混雑を解消し、性能と密度を同時に改善できる。
CoWoS（Chip on Wafer on Substrate）
TSMCが開発した先進パッケージング技術で、複数のチップ（ロジックダイ、HBM など）をシリコンインターポーザー上に並べて高密度に統合する。NVIDIAや AMDの AIアクセラレーターで広く採用されている。
レチクル（reticle）
リソグラフィ装置で1回の露光が可能な最大面積の単位である。1レチクルは約858平方ミリメートル。「14レチクルサイズ」とは、その14倍の面積を持つ巨大なパッケージを意味する。
HBM（High Bandwidth Memory）
複数の DRAMダイを縦に積層し、ロジックチップの隣に配置することで超広帯域なメモリーアクセスを実現するメモリー規格である。AIアクセラレーターには必須の構成要素となっている。
SoIC（System on Integrated Chips）
TSMCの 3Dチップ積層技術である。複数のダイを縦方向に直接接合し、極めて高密度で低レイテンシなチップ間通信を可能にする。
SoW-X（System-on-Wafer-X）
ウェハ全面を1つのシステムとして使うパッケージング技術である。Cerebrasの巨大 AIチップなどで採用されており、基板（substrate）を必要とせず、CoWoSの約40倍の演算能力を1つの「ウェハサイズシステム」に収容する。
TSMC-COUPE（Compact Universal Photonic Engine）
TSMCのシリコンフォトニクス（光集積回路）プラットフォームである。電気信号を光信号に変換する光エンジンをパッケージ内部に直接統合し、データセンターの電力効率とレイテンシを大幅に改善する。
マイクロリングモジュレーター（MRM）
シリコンフォトニクスの中核部品で、リング状の微小な光導波路を使って光の強度を高速に変調する。マッハツェンダー型変調器（MZM）に比べてサイズが小さく、密度を高めやすい。
High-NA EUVリソグラフィ
ASMLが開発した次世代の極端紫外線露光装置である。開口数（NA）を従来の0.33から0.55に拡大し、より微細なパターンを描画できる。1台あたり約3億8000万ドルと極めて高価で、Intelが14Aから採用予定。
AEC-Q100
車載半導体の信頼性を保証する国際規格である。動作温度範囲、耐久試験、不良率（DPPM）の基準などを定めている。Grade 1は最も厳しい温度範囲（-40℃〜+125℃）に対応する。
ADAS（Advanced Driver Assistance Systems）
先進運転支援システムの略称である。自動ブレーキ、車線維持、駐車支援など、ドライバーを補助する機能群を指す。
フィジカル AI（Physical AI）
ヒューマノイドロボットや自動運転車など、物理世界で動作・判断する AIシステムを指す概念である。NVIDIAのジェンスン・フアン CEOらが頻繁に用いる用語で、生成 AIの次のフロンティアと位置付けられている。
ファウンドリ（Foundry）
半導体の受託製造専業企業である。自社ブランドのチップを設計せず、他社（ファブレス企業）の設計を製造することに特化する。TSMCはこのビジネスモデルを1987年に確立した先駆者。
ピュアプレイ・ファウンドリ
製造のみに特化し、自社製品を一切持たないファウンドリのことである。顧客との競合関係が生じない点が、Samsungや Intelの自社ブランド兼業モデルとの差別化要因となっている。
ヒューマノイドロボット
人間型のロボットである。Teslaの Optimus、Figure AIの Figure 02、1X Technologiesの NEO、Boston Dynamicsの Atlasなどが開発を進めており、車載並みの安全性・信頼性を求められる新たな半導体市場として注目されている。
JASM（Japan Advanced Semiconductor Manufacturing）
TSMCが熊本県菊陽町に設立した日本子会社である。Sony、Denso、Toyotaも出資しており、第1工場は2024年から稼働中。第2工場の建設も進んでいる。
【参考リンク】
TSMC A14 Technology 公式ページ（外部）
A14プロセス技術の公式紹介ページ。ナノシートトランジスタや NanoFlex Proなどの技術詳細を解説している。
TSMC Automotive Platform 公式ページ（外部）
TSMCの車載向けプロセス技術ポートフォリオを紹介。N3A、N5Aなど自動車グレード技術と AEC-Q100対応状況を確認できる。
TSMC High Voltage Technology 公式ページ（外部）
N28HV、N16HVなどの高電圧プロセス技術を紹介。スマホや AR/VR向けディスプレイドライバ用途の詳細を掲載している。
TSMC 2026 Technology Symposium 公式ページ（外部）
2026年テクノロジーシンポジウムの公式特設サイト。世界各地の開催スケジュールや発表内容を案内している。
Intel Foundry 公式ページ（外部）
Intelのファウンドリ事業の公式情報。14A、18Aなど競合プロセスのロードマップを掲載している。
Rapidus 公式サイト（外部）
日本の最先端半導体メーカー Rapidusの公式サイト。2nm世代ロジック半導体の量産計画と技術概要を発信している。
ASML 公式サイト（外部）
EUVリソグラフィ装置の世界唯一のメーカーである ASMLの公式サイト。High-NA EUV装置の技術情報を掲載している。
NVIDIA Co-Packaged Optics 技術ブログ（外部）
NVIDIAが TSMC-COUPE技術を活用した光接続プラットフォームを解説する公式技術ブログである。
【参考記事】
TSMC unveils process technology roadmap through 2029: A12, A13, N2U announced, A16 slips to 2027（Tom’s Hardware）（外部）
A13の6%面積削減、N2Uの速度3〜4%向上、A16の2027年スリップ、High-NA EUV非採用方針など、本稿の数値根拠の中心となる詳細分析記事である。
TSMC Unfolds Map for Process, Packaging Tech（EE Times）（外部）
パッケージング技術に焦点を当て、CoWoS進化軌跡や2030年1兆5000億ドル市場予測など、本稿のマクロ視点を支える情報源である。
TSMC Debuts A13, Holds Off on ASML’s High-NA EUV Tools Until 2029（ts2.tech）（外部）
A13発表と High-NA EUV非採用判断を併せて分析。業界アナリストの評価コメントも豊富に掲載した記事である。
TSMC Unveils Next-Generation A14 Process at North America Technology Symposium（TSMC公式）（外部）
2025年に発表された A14の公式プレスリリース。今回の A13を理解するためのベースライン数値の出典である。
TSMC Q1 2026 Revenue: $35.71B Earnings Beat and $56B Capex（tech-insider.org）（外部）
TSMCの2026年Q1決算分析記事。売上高357.1億ドル、HPC/AI関連が58%など、本稿の財務的勢いを裏付ける数値の出典である。
TSMC’s $165 billion U.S. investments examined（Tom’s Hardware）（外部）
TSMCのアリゾナ州への米国投資が累計1650億ドル規模となった経緯と新工場・R&Dセンター計画を解説している。
Intel Foundry Roadmap Update – 14A process node enablement（Tom’s Hardware）（外部）
Intelの14Aロードマップ詳細記事。TSMCとの技術戦略の対比を理解する参考情報である。
【編集部後記】
A13、A14、CoWoS、COUPE──カタカナと英数字の羅列に、少し圧倒された方もいらっしゃるかもしれません。けれど、ここで描かれている2029年の風景は、私たちが手にするスマートグラスや乗る自動車、対話する AIの「中身」そのものです。みなさんが今いちばん「未来」を感じる場面はどこでしょうか。スマホでしょうか、それとも生成 AIとの対話でしょうか。今回の TSMCのロードマップを眺めながら、3年後の自分の生活がどう変わっていてほしいか、ぜひ想像してみてください。私たち innovaTopia編集部も、その未来を一緒に追いかけていきます。
